- エレクトロニクス - ハイブ
- 35 min
- 中学校後半~高校初年、14~16歳
- 日本語
LEDはいつ光り始める?
電圧を変えて実物の緑色LEDを観察し、抵抗の電圧測定から電流を調べます。
- 6回の測定から、電源電圧の変化と計算で求めたLED電流を関連付ける。
- カメラによる観察、電気的な測定、推定を区別する。
生徒向けの質問と回答欄が含まれます。
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電圧を変えて実物の緑色LEDを観察し、抵抗の電圧測定から電流を調べます。
生徒向けの質問と回答欄が含まれます。
Os estudantes usam o laboratório remoto de Boyle da UNED para ler pressão em um vídeo real, calcular PV e 1/V e decidir se a pressão é inversamente proporcional ao volume.
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Os estudantes usam o laboratório remoto de Gay-Lussac da UNED para verificar se a pressão é aproximadamente proporcional à temperatura absoluta em volume fixo.
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Os estudantes usam um circuito de resistores preparado no LabsLand Hive, medem a corrente real com o multímetro em modo de corrente contínua e verificam se o resultado combina com V = I · R.
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Os estudantes usam o laboratório remoto Lei de Snell (II) para ler ângulos de incidência e refração, calcular o índice de refração, comparar meios e observar a reflexão interna total.
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Compare trois couleurs de LED avec la même valeur de résistance et deux tensions d’alimentation.
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El alumnado usa el laboratorio remoto de Boyle de la UNED para leer presión en un video real, calcular PV y 1/V, y decidir si la presión es inversamente proporcional al volumen.
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El alumnado usa el laboratorio remoto de Gay-Lussac de la UNED para comprobar si la presión es aproximadamente proporcional a la temperatura absoluta a volumen fijo.
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El alumnado usa un circuito de resistencias preparado en LabsLand Hive, mide la corriente real con el multimetro en modo corriente continua y comprueba si el resultado encaja con V = I · R.
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El alumnado usa el laboratorio remoto Ley de Snell (II) para leer ángulos de incidencia y refracción, calcular el índice de refracción, comparar medios y observar reflexión total interna.
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Convierte tres lecturas de una jeringuilla real en una recomendación de ingeniería con límite de presión y margen de seguridad.
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Transforme três leituras de um ensaio real com seringa em uma recomendação de engenharia com limite de pressão e margem de segurança.
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El alumnado escribe Verilog para puertas lógicas básicas, sintetiza y sube el diseño a la DE1-SoC, y verifica tablas de verdad con interruptores y LEDs reales.
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El alumnado conecta tablas de verdad, formas booleanas, mapas de Karnaugh y multiplexores, y prueba lógica combinacional minimizada en la DE1-SoC.
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El alumnado construye biestables D y registros en Verilog, prueba reloj y reset, y distingue lógica combinacional de estado almacenado.
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El alumnado implementa contadores y registros de desplazamiento en Verilog, observa patrones secuenciales en LEDs y explica actualizaciones con reloj.
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El alumnado diseña una máquina de estados finitos para una salida tipo semáforo, la sintetiza y verifica transiciones en la DE1-SoC.
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El alumnado sintetiza y sube a la DE1-SoC una FSM de máquina expendedora en Verilog, y prueba interruptores, reset KEY, salida LEDR y crédito en HEX.
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El alumnado escribe VHDL para puertas lógicas básicas, sintetiza y sube el diseño a la DE1-SoC, y verifica tablas de verdad con interruptores y LEDs reales.
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El alumnado implementa una función booleana en VHDL como SOP canónica, la minimiza con un mapa de Karnaugh y prueba extensiones POS/MUX opcionales si hay tiempo.
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El alumnado usa procesos con reloj en VHDL para construir un biestable D y un registro de 8 bits, y verifica la memoria en hardware real.
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El alumnado construye un contador y un divisor de reloj en VHDL, y prueba extensiones opcionales BCD y de desplazamiento si hay tiempo.
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El alumnado construye y modifica una FSM Moore de semáforo en la DE1-SoC, con un detector Mealy opcional.
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El alumnado construye una FSM de máquina expendedora en VHDL, prueba caminos de crédito en hardware y prueba checkpoints opcionales de devolución de cambio si hay tiempo.
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